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企

數(shù)字模擬設(shè)計(jì)主管

40-70萬 | 上海-徐匯區(qū) | 本科 | 1年以下

發(fā)布于：2026-03-16 | 投遞后：10天內(nèi)反饋

上海燁映微電子科技股份有限公司

投遞簡歷收藏職位

職位描述1、負(fù)責(zé)芯片設(shè)計(jì)項(xiàng)目中數(shù)字前端設(shè)計(jì)開發(fā)，包括RTL設(shè)計(jì)，RTL驗(yàn)證，形式驗(yàn)證，RTL綜合，時(shí)序驗(yàn)證，DFT/ATPG等工作；2、依據(jù)系統(tǒng)定義，綜合ASIC電路并協(xié)同模擬設(shè)計(jì)工程師完成系統(tǒng)整體仿真；3、協(xié)助版圖設(shè)計(jì)并進(jìn)行相關(guān)檢查和后仿真，確保版圖達(dá)到電路設(shè)計(jì)要求；...
企

模擬設(shè)計(jì)總監(jiān)

面議 | 上海-松江區(qū) | 碩士 | 無經(jīng)驗(yàn)

發(fā)布于：2025-02-26 | 投遞后：10天內(nèi)反饋

數(shù)明半導(dǎo)體

投遞簡歷收藏職位

職責(zé)描述：1. 負(fù)責(zé)電源和模擬混合信號(hào)產(chǎn)品模擬電路模塊的規(guī)格制定和可行性分析，及具體電路設(shè)計(jì)和仿真分析；2. 參與產(chǎn)品定義和產(chǎn)品可行性評估3. 負(fù)責(zé)系統(tǒng)建模，電路設(shè)計(jì)實(shí)現(xiàn)，按時(shí)高質(zhì)量的完成設(shè)定的項(xiàng)目4. 指導(dǎo)版圖工程師的工作，并對版圖的質(zhì)量負(fù)責(zé)5. 協(xié)助產(chǎn)品的驗(yàn)證和調(diào)試...
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資深模擬設(shè)計(jì)工程師

50-80萬 | 合肥市 | 本科 | 1年以下

發(fā)布于：2025-02-26 | 投遞后：10天內(nèi)反饋

智芯半導(dǎo)體

投遞簡歷收藏職位

1. 模擬或數(shù)?；旌螴C的版圖設(shè)計(jì)，負(fù)責(zé)模塊或者整個(gè)芯片的布局規(guī)劃，物理布局，布線和驗(yàn)證，包括drc，lvs等；2．涉及模擬/數(shù)?；旌螴C版圖的布局布線、設(shè)計(jì)、優(yōu)化和驗(yàn)證；3. 依靠layout布局技術(shù)，以提高電路性能；4. 與設(shè)計(jì)工程師有效合作，在確定布局方案的基礎(chǔ)上...
企

資深模擬設(shè)計(jì)工程師

50-80萬 | 上海-浦東新區(qū) | 本科 | 1年以下

發(fā)布于：2025-02-26 | 投遞后：10天內(nèi)反饋

智芯半導(dǎo)體

投遞簡歷收藏職位

1. 模擬或數(shù)模混合IC的版圖設(shè)計(jì)，負(fù)責(zé)模塊或者整個(gè)芯片的布局規(guī)劃，物理布局，布線和驗(yàn)證，包括drc，lvs等；2．涉及模擬/數(shù)?；旌螴C版圖的布局布線、設(shè)計(jì)、優(yōu)化和驗(yàn)證；3. 依靠layout布局技術(shù)，以提高電路性能；4. 與設(shè)計(jì)工程師有效合作，在確定布局方案的基礎(chǔ)上...
企

資深模擬設(shè)計(jì)工程師

50-80萬 | 蘇州市 | 本科 | 1年以下

發(fā)布于：2025-02-26 | 投遞后：10天內(nèi)反饋

智芯半導(dǎo)體

投遞簡歷收藏職位

1. 模擬或數(shù)模混合IC的版圖設(shè)計(jì)，負(fù)責(zé)模塊或者整個(gè)芯片的布局規(guī)劃，物理布局，布線和驗(yàn)證，包括drc，lvs等；2．涉及模擬/數(shù)?；旌螴C版圖的布局布線、設(shè)計(jì)、優(yōu)化和驗(yàn)證；3. 依靠layout布局技術(shù)，以提高電路性能；4. 與設(shè)計(jì)工程師有效合作，在確定布局方案的基礎(chǔ)上...
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模擬設(shè)計(jì)工程師

30-60萬 | 北京市 | 碩士 | 無經(jīng)驗(yàn)

發(fā)布于：2025-02-26 | 投遞后：10天內(nèi)反饋

昆騰微電子

投遞簡歷收藏職位

一、崗位職責(zé)：1、負(fù)責(zé)模擬與混合信號(hào)電路的設(shè)計(jì)；2、制定電路需求指標(biāo)，進(jìn)行架構(gòu)設(shè)計(jì)，內(nèi)部電路模塊設(shè)計(jì)，底層電路設(shè)計(jì)；3、指導(dǎo)版圖工程師繪制版圖，對芯片進(jìn)行測試驗(yàn)證，書寫設(shè)計(jì)報(bào)告等二、任職要求：1、碩士/博士學(xué)歷；2、有扎實(shí)的模擬電路設(shè)計(jì)理論基礎(chǔ)，掌握主流EDA設(shè)計(jì)工具；...

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